非显而易见性评估仅供参考,不构成法律建议。
| 编号 | 名称 |
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一种装置,包括: 存储器控制器MC,所述存储器控制器MC包括: 存储器内置自测试MBIST控制器,被配置为用于测试至少一个存储器设备,其中所述MBIST控制器包括:存储器表示逻辑,包括存储器转换逻辑,所述存储器转换逻辑被配置为将用于测试所述至少一个存储器设备的信号转换为转换后的信号,所述转换后的信号具有由所述至少一个存储器设备使用的格式,并且其中所述存储器表示逻辑还被配置为提供模拟所述MBIST控制器中的本地存储器的存储器表示,其中所述MBIST控制器还被配置为:接收在小于所述至少一个存储器设备的操作频率的频率处的用于测试的所述信号。
根据权利要求1所述的装置,其中用于测试的所述信号的频率为所述至少一个存储器设备或所述至少一个存储器设备的存储器接口的所述操作频率的一半。
根据权利要求2所述的装置,其中所述MBIST控制器被配置为:在每个MC时钟周期内,在所述MBIST控制器的输出处提供两倍于到所述至少一个存储器设备的数据输入的数据输出。
根据权利要求3所述的装置,其中由所述MBIST控制器输出的所述数据包括以下各项中的一项或多项:命令地址CA信令、时钟使能CKE信令、芯片选择CS信令、数据DQ信令、或数据选通DQS信令。
根据权利要求1所述的装置,其中所述存储器转换逻辑包括有限状态机FSM,所述有限状态机FSM包括被配置为将命令和数据转换为与所述至少一个存储器设备和存储器接口兼容的格式的转换逻辑,所述存储器接口耦合在所述MBIST控制器与所述至少一个存储器设备之间。
根据权利要求1所述的装置,所述MBIST控制器还包括: 相位控制支持逻辑,被配置为在第一相位模式或第二相位模式中的任一相位模式上发出命令或数据中的至少一个,所述相位控制支持逻辑包括交换机构,所述交换机构被配置为将数据总线和CA总线两者移位MC时钟周期的一半。
根据权利要求1所述的装置,所述MBIST控制器还包括: 数据掩码控制逻辑,被配置为用于依赖于特定算法的、对数据掩码DM序列的可编程选择,所述特定算法针对所述至少一个存储器设备的类型而被配置。
根据权利要求7所述的装置,其中所述数据掩码控制逻辑还被配置为:使用组写入使能和交换机构来实现自定义算法所需的不同DM序列。
根据权利要求1所述的装置,所述MBIST控制器还包括: 可编程时延控制逻辑,被配置为针对所述MBIST控制器中的一个或多个信号提供时延控制。
根据权利要求9所述的装置,其中所述一个或多个信号包括以下各项中的一项或多项:写入信号、读取信号、读取使能信号、带有相位控制的输入使能IE/输出使能OE可编程时延信号、可编程数据极性时延信号、禁止数据比较信号、数据命令选择信号、以及选通时延信号。
根据权利要求1所述的装置,其中所述装置还包括: 包含所述MC的主机。
根据权利要求11所述的装置,包括: 至少一个存储器; 通信耦合,其中所述通信耦合被配置为从所述至少一个存储器传达用于测试所述至少一个存储器设备的所述信号。
根据权利要求12所述的装置,还包括: 移动电话和移动通信设备中的一个,包含所述主机、所述通信耦合、以及所述至少一个存储器。
一种用于测试存储器设备的方法,包括: 在存储器控制器MC内发起存储器内置自测试MBIST操作,发起所述MBIST操作包括:使MBIST逻辑与至少一个存储器设备通信,所述MBIST逻辑包括存储器表示逻辑,所述存储器表示逻辑包括存储器转换逻辑;以及利用所述存储器转换逻辑,将用于测试所述至少一个存储器设备的来自所述MBIST逻辑的一个或多个命令和数据转换为转换后的信号,所述转换后的信号具有与所述至少一个存储器设备兼容的格式,并且利用所述存储器表示逻辑提供模拟所述MBIST逻辑中的本地存储器的存储器表示,其中所述MBIST逻辑还被配置为在所述MC的频率下进行操作,其中所述MC操作的所述频率小于所述至少一个存储器设备或所述至少一个存储器设备的存储器接口的操作频率。
根据权利要求14所述的方法,其中所述MC和所述MBIST逻辑的操作的所述频率是所述至少一个存储器设备的所述操作频率的一半。
根据权利要求15所述的方法,其中所述MBIST逻辑被配置为:在每个MC时钟周期内,在所述MBIST逻辑的输出处提供两倍于到所述至少一个存储器设备的数据输入的数据输出。
根据权利要求16所述的方法,其中由所述MBIST逻辑输出的所述数据包括以下各项中的一项或多项:CA信令、CKE信令、CS信令、DQ信令、或DQS信令。
根据权利要求14所述的方法,其中所述MBIST逻辑被配置为并入传统总线集成存储器控制器BIMC中。
根据权利要求14所述的方法,其中所述转换利用存储器转换逻辑来执行,所述存储器转换逻辑包括有限状态机FSM,所述有限状态机FSM包括被配置为将命令和数据转换为与所述至少一个存储器设备和存储器接口兼容的格式的转换逻辑,所述存储器接口耦合在所述MBIST逻辑与所述至少一个存储器设备之间。
根据权利要求14所述的方法,所述MBIST逻辑还包括: 相位控制支持逻辑,被配置为在第一相位模式或第二相位模式中的任一相位模式上发出命令或数据中的至少一个,所述相位控制支持逻辑包括交换机构,所述交换机构被配置为将数据总线和CA总线两者移位MC时钟周期的一半。
根据权利要求14所述的方法,所述MBIST逻辑还包括: 数据掩码控制逻辑,被配置为用于依赖于特定算法的、对数据掩码DM序列的可编程选择,所述特定算法针对所述至少一个存储器设备的类型而被配置。
根据权利要求14所述的方法,所述MBIST逻辑还包括: 可编程时延控制逻辑,被配置为针对所述MBIST逻辑中的一个或多个信号提供时延控制。
一种装置,包括: 存储器,接收用于测试所述存储器的一个或多个指令,所述指令包括:用于在存储器控制器MC内发起存储器内置自测试MBIST操作的命令,发起所述MBIST操作包括:使MBIST逻辑与所述存储器通信; 利用存储器转换逻辑将用于测试所述存储器的来自所述MBIST逻辑的一个或多个命令和数据转换为转换后的信号的命令,所述转换后的信号具有与所述存储器兼容的格式;以及用于利用存储器表示逻辑提供模拟所述MBIST逻辑中的本地存储器的存储器表示的指令,其中所述MBIST操作还被配置为:接收在小于所述存储器的操作频率的频率处的用于测试的所述信号。
一种存储计算机可执行代码的非暂态计算机可读介质,包括用于使得计算机执行以下操作的代码:在存储器控制器MC内实现存储器内置自测试MBIST功能,所述存储器内置自测试MBIST功能被配置为用于测试至少一个存储器设备; 使用所述MBIST功能,将用于测试所述至少一个存储器设备的信号转换为转换后的信号,所述转换后的信号具有由所述至少一个存储器设备使用的格式;以及使用存储器表示功能提供模拟所述MBIST功能中的本地存储器的表示,所述存储器表示功能是所述MBIST功能的一部分,所述非暂态计算机可读介质还包括用于使得计算机执行以下操作的代码:接收在小于所述至少一个存储器设备的操作频率的频率处的用于测试的所述信号。