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对比文件列表
1994-07-15_None_发明专利_JPH06195310A Control data rewriting method to multi-cpu_+++D_g+++.docx
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1995-10-03_None_发明专利_JPH07253960A Ipl system in multiprocessor system_+++A_B_C_D_F_G_H_I_e+++.docx
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1996-06-21_None_发明专利_JPH08161283A Plural processor systems_+++D_E_a_c_h+++.docx
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1997-09-19_None_发明专利_JPH09244902A Download circuit_+++c_d+++.docx
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1999-11-02_US5978589A_发明授权_US5978589A Loading method of base station system in digital cellular system_+++C_D_a_b_e_f_h_j+++.docx
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2002-09-26_US2002138156A_发明申请_US20020138156A1 System of connecting multiple processors in cascade_+++D_E_a_c+++.docx
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2003-02-07_JP2003036251A_发明专利_JP2003036251A Signal processor_+++C_D_G_a_b_e_f_h+++.docx
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2003-05-22_US2003097487A_发明申请_US20030097487A1 Common boot environment for a modular server system_+++A_D_b_c_e_f_g+++.docx
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2004-09-09_JP2004252990A_发明专利_JP2004252990A Computer processor and processing device_+++c_d+++.docx
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2006-07-27_US2006168435A_发明申请_US20060168435A1 Operating-system-friendly bootloader_+++C_D_F_G_b+++.docx
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2006-07-27_WO2006077068A_发明申请_WO2006077068A2 OPERATING-SYSTEM-FRIENDLY BOOTLOADER_+++C_D_G_a_f_h+++.docx
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2007-07-19_JP2007183705A_发明专利_JP2007183705A Multiprocessor system_+++H_a_b_c_d+++.docx
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2007-10-04_KR1020070097538A_发明公开_KR1020070097538A 운영체제에 친숙한 부트로더_+++G_a_c_d+++.docx
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2007-10-17_EP1844394A_发明公开_EP1844394A2 OPERATING-SYSTEM-FRIENDLY BOOTLOADER_+++C_D_G_a_b_h+++.docx
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2008-01-16_CN101107592A_发明公开_CN101107592A 操作系统友好引导加载器_+++C_G_a_d_f+++.docx
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2008-07-10_US2008168443A_发明申请_US20080168443A1 Virtual Devices Using a Plurality of Processors_+++a_b_c_d_e_f_g_h_i_j+++.docx
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2008-11-04_US7447846B_发明授权_US07447846B2 Non-volatile memory sharing apparatus for multiple processors and method thereof_+++A_D_E_b_c_h_i_j+++.docx
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2009-03-11_EP2034416A_发明公开_EP2034416A1 MULTIPROCESSOR SYSTEM AND PORTABLE TERMINAL USING THE SAME_+++C_d+++.docx
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2009-07-08_CN101479718A_发明公开_CN101479718A 多处理器系统以及使用它的便携式终端_+++C_D_E+++.docx
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2009-08-13_US2009204751A_发明申请_US20090204751A1 MULTIPROCESSOR SYSTEM AND PORTABLE TERMINAL USING THE SAME_+++C_D_a_e_j+++.docx
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2009-11-26_None_发明专利_JPWO2008001671A1 マルチプロセッサシステム、マルチプロセッサシステムを使用した携帯端末_+++C_E_G_a_d+++.docx
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EP2550603A1_Description_20260309_2138_+++A_B_C_D_E_F_G_H_J_i+++.docx
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JPS63233460A_Description_20260309_2138_+++d+++.docx
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US2010077130A1_Description_20260309_2138_+++D_a+++.docx
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WO2008001671A1_Description_20260309_2138_+++C_D_e_f_g_j+++.docx
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2003-02-07_JP2003036251A_发明专利_JP2003036251A Signal processor_+++C_D_G_a_b_e_f_h+++.docx

对比文件名称:JP2003036251A Signal processor

目标专利名称:CN105718419B 在多处理器系统中将可执行软件图像从主要处理器直接分散加载到一个或一个以上次要处理器

模型名称:DeepSeek-R1

### 特征比对表格

技术特征描述与公开性判断结果对比文件原文引用公开性论述
技术特征A:所述方法包括:由所述次要处理器初始化与所述主要处理器的通信<br>**隐含公开**【0024】一方、ステップs200において、マイコンB11は、初期化処理を実行し、ステップs205において、データ受信準備OKを意味する認識信号を出力する。図3(B)において、時刻t1に示すように、GPIO信号線70を介して、マイコンB11は、認識信号P1を出力する。对比文件公开了在电源启动时,微控制器B(次要处理器)执行初始化处理后,输出表示数据接收准备OK的“認識信号”(就绪信号)给微控制器A(主要处理器)(步骤s200,s205)。该信号通过GPIO信号线70发送(图3(B))。虽然该信号主要用于通知接收准备状态,但其发送行为本身构成了次要处理器向主要处理器发起或建立通信连接的过程。本领域技术人员可以理解,在启动数据加载流程前,次要处理器需要与主要处理器建立通信联系,发送就绪信号是初始化这种通信的一种常规且合理的方式。因此,对比文件隐含公开了由次要处理器初始化与主要处理器的通信。
技术特征B:由所述次要处理器指令所述主要处理器传送可执行软件图像的图像标头<br>**隐含公开**【0024】一方、ステップs200において、マイコンB11は、初期化処理を実行し、ステップs205において、データ受信準備OKを意味する認識信号を出力する。<br>【0027】認識信号が有ったときは、ステップs120において、マイコンA10は、送信データブロック準備処理を実行する。…ステップs125において、マイコンA10は、マイコンB11に、マイコンBメインプログラムデータブロックを送信する。図3(A)に示すように、マイコンA10は、…データブロックNo.1DB1を送信する。<br>【0042】…図3(A)に示した、最初のデータブロックNo.1は、マイコンB11メインプログラムの開始アドレスとサイズの情報を含んでいる。对比文件公开了次要处理器(マイコンB)通过输出“認識信号”(就绪信号)来触发主要处理器(マイコンA)开始发送数据块(步骤s205, s125)。第一个发送的数据块(DB1)包含了程序(即可执行软件图像)的起始地址和大小信息(【0042】),这相当于目标专利中的“图像标头”。虽然对比文件中次要处理器发送的是通用就绪信号,而非明确包含“传送图像标头”指令的特定消息,但其发送该信号的行为直接导致了主要处理器开始发送包含标头信息(地址和大小)的第一个数据块。本领域技术人员可以合理推断,次要处理器通过发送就绪信号,实质上是在指令主要处理器开始传送包含标头在内的程序数据。因此,该特征被隐含公开。
技术特征C:,所述可执行软件图像包括所述图像标头和至少一个数据片段<br>**直接公开**【0042】…図3(A)に示した、最初のデータブロックNo.1は、マイコンB11メインプログラムの開始アドレスとサイズの情報を含んでいる。データブロックNo.2以降では、プログラムデータが転送される。对比文件明确描述了待传送的程序(マイコンBメインプログラムデータ)由两部分构成:第一个数据块(No.1)包含起始地址和大小信息(相当于图像标头),而第二个及之后的数据块(No.2以降)包含程序数据本身(相当于至少一个数据片段)。这直接对应于目标专利中“可执行软件图像包括图像标头和至少一个数据片段”的技术特征。
技术特征D:由所述次要处理器从所述主要处理器接收所述图像标头和至少一个数据片段<br>**直接公开**【0028】一方、ステップs210において、データ受信待ちになっているマイコンB11は、ステップs215において、プログラムデータブロックを正常に受信したか否かを判定する。<br>【0042】…最初のデータブロックNo.1は、マイコンB11メインプログラムの開始アドレスとサイズの情報を含んでいる。データブロックNo.2以降では、プログラムデータが転送される。对比文件明确记载了次要处理器(マイコンB)处于数据接收等待状态(步骤s210),并对接收到的程序数据块(プログラムデータブロック)进行是否正常接收的判断(步骤s215)。结合【0042】可知,接收的数据块序列中,第一个数据块(No.1)包含地址和大小(图像标头),后续数据块(No.2以降)包含程序数据(数据片段)。这直接公开了次要处理器从主要处理器接收图像标头和至少一个数据片段的过程。
技术特征E:以及由所述次要处理器在所述次要处理器的系统存储器的目标位置中直接存储所述可执行软件图像的所述至少一个数据片段,<br>**隐含公开**【0021】マイコンB11は、受信したマイコンBメインプログラムデータ51をパラレルバス62経由でSRAM12に展開し…<br>【0041】…マイコンB11は、実行開始番地405に基づいて、SRAM12に展開する。对比文件公开了次要处理器(マイコンB)将接收到的程序数据(マイコンBメインプログラムデータ)展开(存储)到其连接的SRAM 12中(【0021】),并且是基于接收到的“実行開始番地”(起始地址)进行展开的(【0041】)。SRAM 12是次要处理器的易失性系统存储器(相当于目标专利的系统存储器),起始地址指示了存储的目标位置。虽然对比文件未明确描述存储过程是否“直接”进行(即是否经过中间缓冲),但本领域技术人员结合上下文(如数据分块传输和确认)可以合理推断,接收到的数据片段被直接存储到SRAM中的指定地址,这是实现数据加载的常规且直接的方式。因此,该特征被隐含公开。
技术特征F:所述目标位置由所述次要处理器根据所述图像标头分配。<br>**隐含公开**【0041】マイコンB11に、実行開始番地405と、データサイズ406と、マイコンBプログラムデータ407が転送されると、マイコンB11は、実行開始番地405に基づいて、SRAM12に展開する。<br>【0042】…最初のデータブロックNo.1は、マイコンB11メインプログラムの開始アドレスとサイズの情報を含んでいる。对比文件公开了次要处理器(マイコンB)在接收到包含“実行開始番地”(起始地址)和“データサイズ”(数据大小)信息的第一个数据块(即图像标头)以及后续程序数据后,基于该起始地址将程序数据展开到SRAM中(【0041】)。这里,“基于起始地址”意味着次要处理器使用从图像标头中获得的信息来确定数据在系统存储器(SRAM)中的存储位置(即目标位置)。虽然“分配”一词可能暗示更主动的地址管理,但根据标头中的地址信息将数据存放到指定位置,其技术实质是根据标头信息确定存储位置。因此,本领域技术人员可以合理推断出该特征,属于隐含公开。
技术特征G:其中所述图像标头包括图像大小以及图像数据在存储器中所处的位置。<br>**直接公开**【0040】マイコンBプログラムデータ407の先頭には、電源起動時にSRAMに展開されるときの実行開始番地405と、データサイズ406の情報を最初に付加する。<br>【0042】…最初のデータブロックNo.1は、マイコンB11メインプログラムの開始アドレスとサイズの情報を含んでいる。对比文件明确记载了程序数据前附加了“実行開始番地”(执行开始地址)和“データサイズ”(数据大小)的信息(【0040】),并且第一个数据块包含了程序的“開始アドレスとサイズ”(起始地址和大小)(【0042】)。这直接对应于目标专利中图像标头包含“图像大小以及图像数据在存储器中所处的位置(即地址)”的技术特征。
技术特征H:进一步包括由所述次要处理器向所述主要处理器发送用于所述至少一个数据片段中的每个数据片段的传输请求。<br>**隐含公开**【0028】正常に受信した場合には、ステップs220において、マイコンB11は、認識信号を送信する。すなわち、図3(B)に示すように、時刻t2において、認識信号P2を出力する。<br>【0030】…マイコンA10がデータブロックNo.k+1を送信後、マイコンB11から認識信号が送られてこない場合には、再度、マイコンA10はデータブロックNo.k+1'を送信する。对比文件公开了数据传输采用分块确认机制:主要处理器(マイコンA)发送一个数据块后,等待次要处理器(マイコンB)发回的“認識信号”(确认信号);只有收到确认信号后,主要处理器才准备并发送下一个数据块(步骤s220, s140, s125)。如果未收到确认信号,则重发当前数据块(【0030】)。虽然“認識信号”是接收确认而非显式的传输请求,但在这种流控制机制下,次要处理器对上一个数据块的确认,实质上构成了允许主要处理器发送下一个数据块的许可信号。从系统交互逻辑看,主要处理器将收到确认信号视为可以传输下一个数据片段的“请求”。因此,本领域技术人员可以合理推断出,次要处理器通过发送确认信号,实现了对每个数据片段传输的间接请求或触发。该特征被隐含公开。
技术特征I:其中所述指令包括由所述次要处理器向所述主要处理器发送包括图像识别、数据偏移以及数据长度的消息。<br>**未公开**【0024】一方、ステップs200において、マイコンB11は、初期化処理を実行し、ステップs205において、データ受信準備OKを意味する認識信号を出力する。对比文件中,次要处理器(マイコンB)发送给主要处理器(マイコンA)的“指令”或信号,仅为表示“数据接收准备OK”的通用“認識信号”(就绪信号)(步骤s205)。该信号是一个简单的握手信号,并未包含任何关于特定图像(如图像识别)、数据偏移或数据长度的具体信息。图像识别、数据偏移和数据长度等信息是由主要处理器在第一个数据块中发送给次要处理器的(【0042】),而非由次要处理器在指令消息中发送。因此,对比文件没有公开“指令包括由次要处理器发送包括图像识别、数据偏移以及数据长度的消息”这一技术特征。
技术特征J:进一步包括由所述次要处理器将用于传入的数据片段的接收缓冲器设置为所述次要处理器的所述系统存储器中的目的地地址。<br>**未公开**【0021】マイコンB11は、受信したマイコンBメインプログラムデータ51をパラレルバス62経由でSRAM12に展開し…<br>【0041】…マイコンB11は、実行開始番地405に基づいて、SRAM12に展開する。对比文件公开了次要处理器将接收到的程序数据存储(展开)到SRAM(系统存储器)中基于地址的位置。然而,对比文件并未描述任何关于“接收缓冲器”的设置过程。具体来说,没有公开次要处理器存在一个专门用于接收传入数据片段的“接收缓冲器”,更没有描述将该缓冲器的地址设置为系统存储器中的目的地地址这一操作。数据可能是直接写入最终存储位置,也可能通过其他未描述的缓冲机制。因此,对比文件没有公开“设置接收缓冲器到目的地地址”这一具体技术特征。

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